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高速系統訊號完整性設計工具的選擇策略

上網時間: 2004年01月01日     打印版  Bookmark and Share  字型大小:  

關鍵字:訊號完整性設計  EDA工具  高速設計  板級設計  模擬工具 

高速數據透過長PCB導線傳輸時很容易受到介質損耗的影響而產生畸變,靠傳統的設計規則很難解決GHz頻段面臨的許多SI/EMI設計問題。本文介紹了透過SpecctraQuest工具給出電路板的分層設計規則和損耗預測的方法,以及用Hspice工具驗證元件模型,並對去耦電容器的選擇和佈局進行電源和地平面分析,用Maxwell 2D和3D場求解工具獲得特殊佈線╱元件結構的精確幾何參數。

隨著通訊系統中高速板設計複雜性的日益提高,依賴某一種特定的CAD工具已經無法在可接受的精密度範圍內完成整個設計模擬。PCB設計工程師和訊號完整性(SI)設計工程師需要採用各種模擬工具。除了價格、性能、速度和精密度始終是選擇工具組的主要準則之外,如何使用來自多家EDA工具軟體供應商的CAD工具來實現設計目標、SI和電磁干擾(EMI)設計規則,也是設計工程師關注的重要問題。一般而言,優良的設計和SI/EMI分析工具的組合應該包括:版圖設計工具、板級模擬器、精確的場求解工具以及詳細的模擬引擎。

本文所討論的工具套件括:Allegro和SpecctraQuest、Hspice、Spicelink和HFSS:Allegro是目前通用的版圖設計工具;由於具備與Allegro相同的資料庫,SpecctraQuest被用做板級模擬的主要工具,避免了數據轉換的問題;Hspice是實現更精確分析的工具;Spicelink和HFSS提供2D和3D場解決方案,對各種互連幾何形狀進行分析(穿孔、連接器等),特別是需要高頻分析的時候。

為了有效地利用現有的CAD工具,要在恰當的設計階段選用相應的工具。本文以卡和主板之間傳輸率為2.5Gbps到12.5Gbps的高速通訊系統為案例,介紹如何正確使用多種模擬工具來解決速度達到Gbps的PCB設計問題。

用SpecctraQuest設立設計規則

Allegro是版圖設計工具,SpecctraQuest是板級模擬工具,兩者組合的優勢在於共享相同的龐大資料庫,採用相同的模擬引擎和類似的圖形用戶介面。由於Allegro和SpecctraQuest進一步整合,設計工程師就能夠在設計階段同時進行版圖設計和模擬。要使設計卡和背板能傳輸2.5Gbps、邊沿速率為100ps-200ps的串列數據訊號,必須掌握在該頻段的SI問題並加以有效地管理。需要了解的主要SI問題包括:趨膚效應、介質損耗、耦合以及驅動器預加重等。SpecctraQuest工具可以模擬和解決下列問題:

a.採用SignalExplorer工具進行預佈局分析並擷取重要節點。隨著電路板的日益複雜化,預佈局分析和設計規則設置越來越重要。採用SpecctraQuest電路圖擷取工具,SignalExplorer能夠根據電路參數變化進行預佈局分析,並能夠將重要的網路節點擷取到電路瀏覽器當中,因而對佈線和版圖後期設計進行檢查。與許多其它的電路級模擬工具一樣,SpecctraQuest的缺點之一是缺乏詳細的建模能力,換言之,IBIS模型是唯一可以採用的元件模型。因此,在SignalExplorer中進行分析之前,必須可靠地評估行為模型。

採用SignalExplorer可以解決下列問題:評估電路板分層的幾何尺寸、估計趨膚效應和介質引起的損耗、給出高速數據╱時脈容許的線長的設計規則、給出控制耦合的線間距、給出終端類型和數值以及所有差分對的最大失配長度。經驗顯示,從上述模擬獲得的設計規則能為工程佈局和佈線提供有價值的指南,因而大幅縮短設計週期並降低設計風險。

b.損耗和補償

趨膚效應和介質損耗通常被認為是千兆數據傳輸板設計面臨的主要問題。趨膚效應決定線的寬度,介質損耗決定於構成PCB的材料。要解決這兩個基本問題,板級模擬器必須具備處理具有頻率獨立參數的有損傳輸線的能力,SpecctraQuest就滿足這個要求。模擬和測量結果顯示,在GHz頻段介質損耗佔主要地位。

在通訊系統中,高速數據要透過長的導線傳輸,因而很容易受到介質損耗的影響而產生畸變。克服這種損耗影響的一個方法是採用均衡器和預加重器。均衡方法有幾種可供選擇,本文只討論採用被動元件的均衡電路。而因為大多數元件都內建了均衡電路,IBIS類模型很難對其補償。

透過把被動元件從元件中分離出來放到電路板上,我們可以對均衡效應進行模擬。利用SpecctraQuest分析修改後的網表,可以獲得均衡器應用的通用指南。

當介質的影響不大時,均衡器不應該產生作用。均衡器的作用是補償長互連線上的高頻成分損失。預加重可能會導致較短互連線的視圖變壞。隨著互連線的成長,FR4板材的介質損耗會越來越大。訊號的高頻成分(對應於陡峭的上升╱下降沿)會消失,低頻成分則被保留下來。為了有效地使用預加重功能,必須首先估算訊號傳輸路徑上互連線的長度,然後決定是否採取補償措施。對所有傳輸高速率的互連線都採取預加重處理並不是最最佳化的。

表1比較了2.5Gbps訊號透過不同長度的差分互連線時,預加重器處於開╱關兩種狀態下視圖窗口和抖動的差異。

c. GHz頻段的耦合

在數據率低於Gbps的時候,耦合一直是PCB設計中影響噪音指標的主要因素。由於耦合訊號的頻率成分比入侵訊號的頻率成分更高,所以其損耗比原始的Gbps訊號受到的損耗要大,自然對噪音指標的影響就降低了。

大多數版圖設計工具根據由佈線幾何形狀和材料決定的耦合係數來估算耦合的影響,這就導出了限制平行距離的線性估計公式,它降低了佈線密度。事實上,在長的佈線上耦合會達到飽和狀態。在估算過程中忽略飽和效應會導出比需要量更密的佈線設計規則。為此,要採用SpecctraQuest進行全面的模擬以決定設計中的耦合規則。

對於2.5Gbps數據,上升時間的典型值是150ps,飽和長度大約是300mil,這就是說,實際耦合線可以長於300mil而不增加耦合預算值。表2顯示了2.5Gbps速率、擺幅500mv、上升時間為110ps的訊號的耦合飽和參數和損耗。耦合在大約300-400mil處達到飽和,因為損耗使其幅度在長佈線上出現較大衰減。根據這一規律,設計工程師可以更有效地佈線,而這一點比許多版圖設計工具給出的設計規則更有效。

用Maxwell 2D/3D設計複雜佈線結構

對於傳輸速率在10G到12.5Gpbs的較高速率,FR-4板材會產生很大的損耗,要採用其它損耗特性更佳的板材。如圖1所示為一種共面結構的電路板,它被用於在電路板頂層傳輸10Gbps到12.5Gbps的數據,所用的板材為RO4350。該板材的介質損耗很低,但是只能在頂層╱底層佈線,因而傳輸10GHz訊號要用表層線。採用共面結構訊號的品質比較好,EMI比較低。要採用3D場求解工具運算線寬和間隔以確保50歐姆的線阻抗,使之與驅動電路輸出阻抗匹配。可以採用Maxwell 3D場求解工具。

連接器的建模

訊號以Gbps數據率傳輸時,穿孔、連接器和相關的線頭會引起訊號完整性問題,連接器和穿孔效應的精確建模和模擬對於預測訊號品質非常重要。

Maxwell 3D場求解工具用於擷取連接器的VHDM和HSD模型,連接器模型設立後,要以SpecctraQuest DML格式嵌入,用於Hspice子電路進行板級模擬。一般來說,即使成功設計出來Gbps速率的卡,要設計傳輸速率達到5-10Gbps的背板仍然會面臨諸多挑戰。Maxwell場求解工具有助於為實現這樣的數據率製作連接器模型。

採用Hspice進行詳細分析

a. 採用Hspice進行電源層分析圖1:共面結構的電路板。

在GHz頻段,電源的傳遞面臨新的挑戰,要採用精密建模技術和分析工具來獲得真實的(電源)平面響應。Hspice是一個能夠實現精密掃頻分析的工具,並具有基於電晶體的IC模型以便對感興趣的並發開關噪音(SSN)進行模擬。

對於向高頻差分元件傳遞電源的電源層,可以採用傳輸線網孔模型來評估高頻時電源╱地平面的行為。例如,要分析PCB中一對2英寸×2.5英寸的電源╱接地平面,平面間隔3.5mil,要求邊沿速率70ps,頻寬5GHz。一般的做法是根據某個主要的差分元件的參數指標,每一個差分電源╱接地平面對的目標阻抗預算為272m?,傳輸線網孔模型用來確定電源?地平面的頻域響應。對於1Gbps以上速率,建議要分別考慮有損和無損情況以確定在模型中加入介質損耗的影響。

該模型用於進行Hspice模擬,得到的諧振頻率為1.2GHz,模擬結果顯示:透過在電源╱接地平面考慮介質損耗問題,能夠大幅降低諧振振幅,有助於電源╱接地平面的頻域響應以達到目標阻抗的要求。由於多數高速串列數據都是採用差分傳輸方式,該電源╱接地平面專用於2.5Gbps差分訊號的傳輸。理想情況下,差分元件因具有差分特性而不吸取瞬態電流。因此,實際上目標阻抗可以更高一些,透過減少不必要的PCB層數,還可以避免超指標要求進行設計。

b. 採用Hspice評估元件並進行高頻分析

儘管IBIS模型廣泛用於板級模擬,在新元件評估中,基於電晶體驅動器╱接收器模型的分析仍然至關重要。隨著IC製造商越來越多地以Hspice加密形式提供基於電晶體的模型,Hspice逐漸成為元件評估的唯一工具。這樣的模擬應該包括加載╱卸載封裝效應、以及元件不同類型和長度的驅動傳輸線。為此,需要製造商合作提供正確的模型並根據實際元件的情況修改模型。確定了元件之後,就可以根據最終Hspice模型和功能指標製作和驗證IBIS模型。在更高的訊號速率,例如10-12.5Gbps,行為模型不再有效,對於工作在該頻段的元件,試圖製作IBIS模型是沒有意義的。

模擬工具整合流程

根據上述研究和SI設計指南,我們成功地設計了收發速率達到12.5Gbps的電路板,該板向40Gbps元件傳送2.5Gbps速率的數據。前面已經詳細討論了怎樣利用CAD工具解決不同的設計問題,然而,設計工程師通常忽視的一個問題是:在高速設計過程中,面對眾多的EDA工具何時選用何種工具?因此,設計過程中,應該按照下列標準的流程來整合模擬工具:

採用Hspice和SpecctraQuest開發SI模型;

採用Maxwell和SpecctraQuest開發電路板的分層策略、各層參數和佈線模型;

採用Hspice進行去耦電容器電源平面分析;

採用SpecctraQuest進行底層規劃、版圖指標確定、預佈線分析和佈線後驗證。

為了高效地執行這個流程,硬體設計工程師和設計管理人員必須掌握SI和EMI的基礎知識。

發展趨勢

目前,在EDA工具領域,除了針對特殊產品的專用訊號完整性設計工具之外,採用整合方法以滿足高速PCB設計產業對EDA工具的迫切需求已經成為提升設計產業技術水準的一個重要發展趨勢,這表現在以下幾個方面:

高速設計疆界已經由過去的通訊產品擴展到行動電話、數位影像之類的消費電子產品。EDA工具供應商逐步認識到,他們所提供的工具解決方案必須速度更快,必須能夠解決更複雜的設計問題,必須高度整合以解決PCB設計產業面臨的全方位挑戰,因而縮短複雜高速電路板設計週期。

隨著高速元件、連接器、積體電路應用的日益增多,對整合多種建模語言的PCB訊號完整性設計工具存在很大需求。Mentor Graphics公司的ICX 3.0就是一種可選的方案,它在單一模擬環境下支援SPICE、IBIS和VHDL-AMS的PCB訊號完整性工具,因而避免因模型種類不同、採用多種不同來源的EDA工具組帶來的開發週期被拖延的問題。

隨著越來越多的高速PCB採用複雜封裝的IC,由於PCB和IC中包含有多重、任意形狀的電源╱接地層、任意數量的過孔和訊號線段,噪音、電源╱接地層的反彈、共振、反射,以及導線線段與電源╱接地層間的耦合問題將更加嚴重,PCB設計不可避免地要考慮IC的封裝因素,如何產生PCB和IC的頻域和時域模型,以便進行系統級模擬也是業介面臨的一個重要課題。在EDA工具內部整合的全分波析引擎,透過對板級電磁場的特徵分析來完成板級模型的量化和處理。

作者:王霞


Email: szwangxia@tom.com




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