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FPGA/PLD  

Altera、InterNiche、MorethanIP共同提供聯網參考設計

上網時間: 2005年07月01日     打印版  Bookmark and Share  字型大小:  

關鍵字:Altera  InterNiche  MorethanIP  聯網參考設計  Nios II 

AlteraInterNicheMorethanIP日前表示,將開始提供Altera Nios II嵌入式處理器聯網參考設計。該參考設計可在100Mbit鏈路上通過TCP/IP技術實現超過60Mbit的傳輸量,讓嵌入式設計人員在需要大傳輸量網路連接應用中展現其靈活性、高性能和易用性。

該參考設計採用裝有Cyclone EP1C12 FPGA的低成本Nios II評估板,並包含了:白皮書、文件檔資料、設計檔、立即可用的示範檔、來自MorethanIP的MAC-NET;以及來自InterNiche的NicheStack IPv4聯網堆疊。其中MAC-NET為帶有整合網路協定加速功能的高性能乙太網路媒體存取控制器(MAC)。

Altera表示,嵌入式設計人員可以使用Altera SOPC Builder工具和Nios II整合開發環境(IDE)來訂製採用MorethanIP MAC-NET內部核心和InterNiche NicheStack IPv4軟體堆疊的參考設計。

另外,SOPC Builder使系統工程師能夠在系統中的Nios II處理器、MAC-NET內部核心和其他週邊之間快速加入、編輯、指定連接。然後採用Avalon交換架構連接所有周邊,使MAC-NET內部核心能夠通過本地記憶體資源高效地傳送資料。

MAC-NET內部核心支援10/100/1000Mbit乙太網路連接,其第3和第4層校驗模組可支援InterNiche NicheStack TCP IPv4、IPv6以及用戶數據報協議(UDP)通訊協定的網路運轉。InterNiche NicheStack IPv4提供了可配置TCP/IP協定組,帶有完整的管理和安全協定,包括SNMP、SSL、Ipsec和嵌入式HTTP伺服器,以及對IPv6的無縫式支援。





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