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FPGA/PLD  

結構化ASIC開始受到大型晶片供應商青睞

上網時間: 2005年08月12日     打印版  Bookmark and Share  字型大小:  

關鍵字:結構化ASIC  標準單元ASIC  FPGA  structured ASIC  standard-cell ASICs 

當幾年前結構化ASIC剛問世時,一般均認為它將可成為小型系統製造商在標準單元ASICFPGA之外的第三種選擇。

然而,隨著結構化ASIC的不斷發展,它不再僅為小公司所用。在某些情況下,大型晶片公司也禁不住誘惑,選擇結構化ASIC作為解決晶片快速上市或研發預算吃緊等問題的良方。

Altera公司宣佈,TI已在其數位光學處理技術(DLP)晶片組中選用了HardCopy結構化ASIC。而在此之前,英飛凌宣佈採用HardCopy開發出了一款針對Ethernet-over-Sonet(EoS)應用的元件。

為什麼這些公司雖然擁有自己的晶片設計團隊,卻要採用其它公司的資源呢?據Altera表示,使用傳統設計方法時,設計、除錯和完成一個ASIC原型的最短週期是固定的。如果一家晶片公司想在即將召開的展覽會上展示最新成果,但進度卻落後於預定計畫時,結構化ASIC就是突破困境的法寶。Altera透露,在TI的案例中,Altera可以在設計定案後的10週內提供首批HardCopy樣片。

“標準ASIC的開發耗時兩年,而且時間並不會因投入資源的增多而減少。就某些時候來說,是無法進一步壓縮設計週期的。”Altera的HardCopy產品部副總裁Alain Bismuth表示。

結構化ASIC的密度及速度都不能與標準單零組件相較,但卻勝於FPGA,而且原型設計時間比標準單元晶片更短。對某些公司或某些計畫而言,這些理由足以支持他們利用結構化ASIC去開發一款足夠好的晶片。

其它的結構化ASIC供應商也指出半導體公司對結構化ASIC的高度興趣。台灣智原科技大約在一年前推出首款結構化ASIC平台,目前已有10家公司使用其產品。其中,三分之二的客戶是晶片公司,智原科技負責國際業務的副總裁Charlie Chen介紹道。

Chen表示,許多公司都認為開發0.13微米晶片的巨額成本是令他們望而卻步的原因。“除非一年有一百萬的出貨量,否則毫無意義。”他說。

在智原科技的案例中,晶片在提供客戶之前有60%是標準單元閘。預製部份包括一些模組,如用於乙太網路標準或DDR記憶體的控制邏輯等。

晶片公司是否將摩肩接踵地向結構化ASIC轉移還很難論斷。結構化ASIC供應商通常是不允許公開客戶名單的,因此當Altera獲准引用一些大型晶片公司的名字時,它理所當然會充分利用這個機會。

Altera的頭號競爭對手Xilinx,仍然對結構化ASIC嗤之以鼻,而這恰好也給Altera更多的理由對結構化ASIC進行大量宣傳。至少這次的客戶宣佈使那些未採取行動的廠商開始轉而對結構化ASIC予以關注。

作者: 趙子龍





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