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Altera量產具整合式11.3Gbps收發器的FPGA

上網時間: 2009年10月26日     打印版  Bookmark and Share  字型大小:  

關鍵字:收發器  Stratix  EP4S100G 

Altera公司宣佈量產出貨首款具整合式11.3-Gbps收發器的FPGA──Stratix IV GT EP4S100G2 FPGA。Stratix IV GT FPGA能夠滿足下一世代訊框器、媒體存取控制(MAC),並針對100-Gigabit乙太網路(GbE)與100-Gigabit光傳輸網路(OTN)的橋接與交換應用,符合高速頻寬需求的單晶片元件。

相較於使用ASIC、ASSP與其他現有的FPGA技術,Altera公司經過驗證的高密度、高效能100G解決方案,能夠讓通訊系統設計師在開發100G系統時,加速他們產品及時上市的速度,並降低開發風險。

Altera的100G解決方案包括已量產的矽晶片、100G系統的矽智財(IP)、100G系統參考設計,以及支援100G應用的開發板。到目前為止,已經有廣泛的客戶在100G系統與平台上採用Stratix IV GT FPGA,包括100G測試設備、100G乙太網路傳輸、10 x 10Gigabit乙太網路(GbE)封包聚集與光傳輸網路應用。此外,前七大高密度分波多工(DWDM)供應商已經有五家選擇Stratix IV GT FPGA,用於他們的100G系統開發。

Stratix IV GT FPGA是專門設計用來符合新興的IEEE 802.3標準,這個標準已使用在先進的有線與軍事通訊系統與高階測試設備的100G系統中。Stratix IV GT FPGA目前已可供貨以符合客戶量產上的需求,並可在這些100G標準定案之後符合其效能上的要求。

在EP4S100G2中所具有的36個收發器通道,可在2.488Gbps到11.3Gbps之間運作,且可提供FPGA產業中最低的抖動效能,以符合10G、40G與100G通訊協定規格。整合式11.3-Gbps收發器可免去外部實體層(PHY)的需求,允許Stratix IV GT FPGA與10G、40G或100G光纖模組之間採用直接介面。

Stratix IV GT EP4S100G2 FPGA是一個具有較低系統功率消耗的單一元件,可縮減電路板的複雜度,並提供以下的功能,使其擁有較低的整體開發成本:共有36個收發器,其中的24個以11.3Gbps運作;低至0.95-V的核心功率消耗;具有晶片內與封裝內去耦合的雜訊濾波功能;1,067-Mbps(533-MHz)DDR3記憶體,以及230K邏輯單元(LE)、13.9-Mbits內部隨機存取記憶體(RAM),與1,288個18 x 18乘法器。Stratix IV GT EP4S100G2 FPGA現可量產出貨。





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