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S2C的TAI Verification Module加速FPGA原型驗證

上網時間: 2011年06月09日     打印版  Bookmark and Share  字型大小:  

關鍵字:FPGA  驗證  TAI Verification Module  RTL  PCIe 

S2C 公司日前宣佈,已開發出一款原型驗證產品── TAI Verification Module(專利申請中)。該模組允許使用者透過一條x4 PCIe Gen2通道到連接FPGA原型中的用戶設計和用戶的電腦,使得使用者能夠使用大量資料和測試向量對FPGA原型中的用戶設計進行快速驗證。

基於Altera Stratix-4 GX FPGA的TAI Verification Module將Altera 的SignalTap Logic Analyzer 已經整合到 S2C 的 TAI Player 軟體中,它能支援在多個 FPGA 進行RTL 層次除錯。這項創新的技術在設計編譯過程中建立了多組,每組480個probe,從而使使用者能在不需要進行冗長的FPGA重新編譯的情形下在多個FPGA中查看數以千計的RTL級probe。

S2C 董事長暨首席技術長Mon-Ren Chene表示,該公司注意到許多客戶都想把他們PC端大量的測試資料傳送給基於FPGA的原型或者將基於FPGA的原型測試結果傳送回PC。此外,多數客戶運用FPGA廠商的工具來進行驗證除錯,而且在最近,更多客戶使用新的協力廠商工具。而FPGA廠商工具的一大限制就是其一次只允許客戶除錯一次FPGA。這對單一FPGA解決方案較適宜,但對多FPGA解決方案則侷限性很大。

而新的Verification Module技術能透過一條 x4 PCIe Gen 2通道使基於FPGA的原型和用戶的驗證環境達到雙向快速的資料傳送。TAI Verification Module也能允許用戶同時查看多顆FPGA發來的訊號。”

S2C S4 TAI Verification Module提供了三種使用方式:Verification Mode(驗證模式)、Debug Mode(除錯模式)及Logic Mode(邏輯模式)。驗證模式使用SCE-MI或定製的C-API通過一條 x4-lane PCIe Gen2通道實現大量資料和PC之間的傳輸。在除錯模式中,S4 TAI Verification Module通過使用Altera SignalTap且同時保持用戶的RTL名從而實現了多個FPGA的同步除錯。在邏輯模式中,使用者能原型化一個設計,其容量能達到3.6M門。 Verification Module中所有的除錯和驗證設置都在TAI Player Pro中完成。

驗證模式利用TAI Verification Module的高速PCIe Gen2介面將大量驗證資料在PC和TAI Logic Module之間進行雙向快速地傳輸。該模式能將原型系統和模擬器直接連接進行同步模擬。

除錯模式則利用了使用者現有的Altera SignalTap除錯環境。TAI Verification Module從TAI Logic Module中的多個FPGA獲取使用者定義的訊號通過JTAG介面與SignalTap連接。

Quad S4 Logic Module中每個FPGA的120訊號都接到了Verification Module的FPGA中。用戶能在Quad S4 Logic Module的每個FPGA中進行120 x N訊號的路徑選擇。在最初的軟體發佈版本,N固定在4上,但是在今後的版本中這將由用戶來定義。所有的用戶必須在設計綜合前在RTL級選擇Probes並且將它們按照每個FPGA120個probe來進行分組。TAI Player Pro自動採用的多工技術將來自多個FPGA的除錯訊號發送至Verification Module的單個AlteraSignalTap,並保留RTL的名字。在使用Altera的SignalTap除錯過程中的除錯資料存儲在Verification Module FPGA的記憶體中,只要預先設置的觸發條件滿足,就會透過SignalTap 將資料回送至電腦上以供除錯。

另外,S4 TAI Verification Module能作為小規模的SoC或ASIC設計高達3.6M門容量的單個原型使用。S4 TAI Verification Module能配置在AlteraStratix IV 180或360 GX FPGA上,並且在4個 LM連接器上共有480個外部I/O,x4 PCIe Gen2介面和2對SMA介面的GigaBits收發器。





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