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Synplicity為FPGA整合提供先進解決方案

上網時間: 2005年10月11日     打印版  Bookmark and Share  字型大小:  

關鍵字:synplicity  fpga synthesis tool  fpga  工具  physical synthesis 

Synplicity公司日前擴充其Synplify家族FPGA整合工具,以滿足目前複雜FPGA元件設計需要。Synplicity的synplify premier為FPGA設計人員提供了一個整合開發環境,採用該公司獨有的FPGA整合技術,此一軟體利用採圖形化的實體合成(physical synthesis)技術和功能強大的RTL除錯工具(Identify RTL Debugger),具有一鍵式實體整合流程的功能。

Synplify Premier的核心是該公司新的採用圖形的實體整合技術,一個自動化的單通道設計流程能為開發人員提供先進的時序性能,可以大幅提高時序關聯性並縮短設計周期。採用圖形方法進行實體合成,設計人員能更快地進行時序分析,同時可使產品性能提高20%(與單獨採用邏輯整合相較)。

由於ASIC設計人員對其設計越來越依賴FPGA原型,因此需要一種能將HDL代碼寫入FPGA作為原型的整合和驗証環境,Synplify Premier可滿足這種需求,該軟體可自動執行閘控時脈轉換和控制時脈以及Synopsys DesignWare組件。Synplify Premier針對單FPGA原型,同時該公司的Certify RTL原型工具可透過先進的隔離和接腳多工技術實現多FPGA原型。Synplify Premier現已上市。





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