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工程師自行研發出邏輯設計工具

上網時間: 2005年12月30日     打印版  Bookmark and Share  字型大小:  

關鍵字:邏輯規格  電晶體  Espresso  FPGA  IC設計師 

在實驗室進行了容錯飛行控制系統(fault-tolerant flight control systems)的設計工作之後,Dave McFarland意識到並沒有很好的方式可以來指定邏輯,並兼顧所有可能的組合。因此他製作了一種能夠處理這項任務的工具。McFarland的邏輯設計工具(Logic Design Tool,LDT)是開發數位控制的一種圖形好幫手,針對組合且連續的邏輯,產生完整的規格,使用戶能指定所有電晶體的所有狀態及所有輸入組合。

然後該項工具能提供邏輯的多個視角,識別停滯等狀態,搜尋最優和最差情況下的性能路徑,並產生C、Pascal、Ada、VHDL或Espresso原始檔案。身為一名曾在波音(Boeing)和United Technology公司工作過的嵌入軟體工程師,McFarland表示,「如果有超過4個或5個變量,目前的規格就會出現問題。」

而他研製的LDT包含一項涵蓋該工具部份技術的專利,並計畫將LDT透過網站www.logicdesigntool.com商用化。LDT適合於任何投入數位邏輯的用戶使用,包括FPGAIC設計師。LDT採用卡諾圖(Karnaugh)分層,把輸入變量與下一狀態輸出變量相互關聯。據McFarland表示,LDT提供最低限度的邏輯,緊密匹配Espresso演算法。(原文連結處:Engineer readies tool that generates logic specs)

(Richard Goering)





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