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Cadence自動化設計流程支援Cortex-A8處理器

上網時間: 2006年08月03日     打印版  Bookmark and Share  字型大小:  

關鍵字:ARM  CORTEX-A8  SoC  Cadence  RTL 

CadenceARM日前聯合宣佈,推出業界首個以ARM Cortex-A8處理器為基礎的RTL自動化設計和實現流程。這個經過ARM認證的流程命名為「Cadence Encounter Express Flow for the Cortex-A8 Processor」,具1500 Dhrystone MIPS能力,並將多種功能整合在一個簡單的、可合成的方法學中。

這個以Cadence Encounter數位IC設計平台為基礎的自動化設計流程,由ARM與Cadence的工程師歷經12個月共同開發完成。本次合作始於2005年中,最終完成了一個90奈米製程的參考實現用例。圍繞Cortex-A8的設計,特別開發了大量的RTL合成、佈局、時序和時脈的增強功能,並與最新的Encounter版本相結合。

該設計流程號稱可供系統級晶片(SoC)設計人員,迅速地在下一代行動、消費電子及其它應用中使用高性能、低功耗的處理能力。這一新的流程可以幫助小型設計團隊在短短數月內實現高性能的設計投片,縮短產品上市時間並提供成本優勢。

Cortex-A8處理器具有先進的超純量管線架構,可同時執行多個指令,處理能力可達2.0 DMIPS/MHz。為了滿足日益苛刻的消費電子應用要求,Cortex-A8可合成處理器將在90奈米製程下實現750MHz的處理速度。該處理器將在65奈米低功耗製程下實現500MHz的處理速度,晶片尺寸僅為4mm2(不包括NEON技術、Trace技術和高速緩衝記憶體)。

ARM的RealView系列嵌入式軟體和ESL工具全面支援ARM Cortex-A8處理器,此外亦有許多軟體與EDA工具廠商的產品也對Cortex-A8處理器提供支援,包括CodeSourcery、Green Hills、Lauterbach、Microsoft、MontaVista、Symbian和WindRiver等公司。ARM Cortex-A8處理器的許可廠商包括Freescale、Matsushita Electric Industrial、Samsung和TI等。




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