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實現在90奈米製程之低電壓數位類比轉換器

上網時間: 2007年12月04日     打印版  Bookmark and Share  字型大小:  

關鍵字:DAC  數位類比轉換器  通訊  電路設計 

在現今的通訊系統中,數位-類比轉換器(Digital-to-Analog Converter,DAC)依舊扮演了一個重要的角色,同時對於高速操作與低功耗的要求也日益增加。本文主要介紹一個應用於通訊系統中之數位類比轉換器電路設計。其解析度為十位元、update rate達到200MHz,同時可提供0.5Vpp差動輸出信號。

模擬結果顯示當輸入信號頻寬為39.45MHz且update rate為200MS/s時,SFDR達到54dBc,ENOB可達8.4位元。此數位類比轉換器實現在90奈米製程上,且操作電壓為1.2V。

1. 前言

在通訊系統的應用中,高取樣率且高解析度的數位類比轉換器一直是一個相當重要的區塊。根據目前無線通訊系統的要求,數位類比轉換器將被要求處理到100MHz的信號頻寬(signal bandwidth)。在這樣的要求下,數位類比轉換器通常需要解析度達到10位元以上,且update rate在200MS/s以上。

由於不需要額外的輸出級放大器做電流/電壓轉換,且電路內部沒有大的電容性節點需要做充放電的動作,Current-steering DAC架構一般被認為適合產生這樣的寬頻輸出信號,因此常被用來實現通訊系統中的數位類比轉換器。且在通訊系統的應用中,頻域上的表現要比靜態規格來的重要許多,其中包含了spurious free dynamic range (SFDR),訊雜比(SNR)等,而Current-steering DAC架構同時也提供了較好的頻域特性。

請下載PDF文件,以閱讀完整文章。

作者:游爵豪 / 系統晶片科技中心




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