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ADI全新500mA LDO可在100kHz提供60dB PSRR

上網時間: 2011年02月15日     打印版  Bookmark and Share  字型大小:  

關鍵字:ADP 124  ADP 125  穩壓  電源抑制  PSRR 

美商亞德諾(Analog Devices, Inc., ADI)新推出兩款低靜態電流低壓降線性穩壓器(LDO)── ADP124, ADP125,具有在100kHz下的60dB電源抑制比(PSRR)性能,以及在1.8 V 輸出下達成35 uVrms 的低雜訊特性,可協助電池供應的可攜式設備提升運作時間與效率。

這些新的 LDO 在介於2.3 V 與5.5 V 之間的輸入電壓下運作,並對低至0.8 V 的輸出提供高達500 mA 的輸出電流,此外還具有在500 mA 負載下210 uA 的低靜態電流以及130 mV 的壓降電壓,能夠進一步改善可攜式設備在廣大輸入電壓範圍中的運作效率。

「可攜式產品設計的解決方案需要具有小巧的尺寸、低功率消耗、以及高電源供應抑制,以獲得最佳的混合訊號處理性能,特別是在電源成為隱藏雜訊源的狀況下,」ADI 電源管理事業群產品線經理 Walt Heinzer 表示,「這些高性能 LDO 具有60 dB 的優越 PSRR(電源抑制比),相較於提供25 dB 或30 dB 的商用 LDO 而言高出30dB -- 或是在對數標度下高於30倍的效能。」

ADP 124提供了31組固定輸出電壓選項,範圍從1.75 V 至3.3 V。ADP 125 LDO 則藉由外部分壓器的使用,提供了可以在0.8 V 至5.0 V 之間作調整的輸出電壓。ADP 124以及 ADP 125乃是針對以微小的1uF 陶瓷輸入與輸出電容器的穩定運作所特別設計,以便符合高性能、空間有限的應用領域的需求。這些 LDO 採用小巧的2 mm x 2 mm x 0.55 mm LFCSP 封裝方式,或是8只接腳外露焊盤 MSOP 封裝方式。

新元件具備1%的初始精確度,為 FPGA 應用裝置中的核心電壓軌提供了嚴密的容錯度。在500mA 下130mV 的極低壓降電壓能將電源耗損最小化,並使得作業可以進一步的降低電池放電曲線。而在1.8 Vout 下35 uVRMS 的低雜訊特性,則為高性能 A/D 轉換器提供了乾淨的電源供應,不需要額外的輸出旁通電容器。此外,以1 uF Cout 陶瓷電容器實現的穩定度能夠使空間有限的應用裝置維持精巧的佔位面積。

用以簡化產品評估過程的 Redykit評估套件目前已經開始供貨。該套件中包含有評估電路板以及具有其它電壓選項的額外元件。ADI 的ADIsimPower 電源管理資源與工具標籤也可提供線性穩壓器工具。





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