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Cadence全新RTL合成軟體Genus問世

上網時間: 2015年06月18日     打印版  Bookmark and Share  字型大小:  

關鍵字:Genus  RTL合成軟體  Cadence  平行架構 

益華電腦(Cadence)推出全新RTL合成軟體 Genus,強調透過採用多層次大規模平行架構,能使合成週轉時間縮短高達五倍並可線性擴充至1千萬實例(instance)以上大的設計。Cadence的合作夥伴Imagination Technologies採用Genus合成解決方案在其PowerVR GE7800 GPU,在不影響功耗、性能和面積目標,使合成週轉時間加速高達五倍。

Cadence指出,隨著SoC的設計規模與複雜度日益提升,一顆16奈米製程晶片上的實體模塊(physical block)數量將超過500個,是40奈米製程的十倍之多。若要持續藉由擴增設計團隊來為應付此設計規模成長,在實務上是不可行的。

而設計實現軟體工具為什麼無法跟上設計規模的成長主要原因在於,目前的合成、佈局與最佳化工具無法有效地分散在多台機器上執行而不會影響功率、效能和面積(PPA)目標。同時,數位設計需要多次反覆的特質也是另一個因素,隨著製程節點微縮,更複雜的實體設計規則使得模塊層級(block-level)的合成設計必須大幅耗費合成runtime才能與後段的佈局佈線(P&R)更具關聯性。

為了克服這些挑戰,Cadence推出的新一代Genus合成工具便是專為縮小SoC「設計生產力落差」(design productivity gap)所設計。它具備優異的可擴充性,能平行處理大量的功能模塊,可在多重核心與機器之間執行時序驅動型分散式合成作業,合成流程中所有主要步驟均能有效運用多部機器與各機器中的多重CPU核心。

而透過最新的實體意識內容(physically aware context-generation)生成功能,設計中任何子集(subset)的完整時序與實體內容均可擷取,並於全面考量晶片層次時序與佈局之下用於驅動RTL單元層次合成作業,藉此大幅減低晶片層次(chip-level)與單元層次(unit-level)合成週期的反覆率達2倍以上。

此外,Genus能與日前發佈的Innovus設計實現軟體工具緊密結合,共同將時序驅動型全域繞線器運行速度提升四倍,使合成至佈局與繞線期間,時序與線長的關聯性緊縮至5%以內。

Genus合成方案還導入了新的全域解析演算法(Global analytical architecture-level),採用最新資料路徑(datapath)最佳化引擎,可考量全盤設計中多種不同資料路徑架構,再運用解析式解算器挑選可達成全域最佳化PPA的架構。此引擎不僅可降低資料路徑面積達20%,更不會對性能造成任何影響。

Genus甫一推出便已獲得合作夥伴Imagination Technologies的採用。Imagination是繪圖處理器GPU IP的領先供應商,該公司表示,Genus合成解決方案可加速Imagination繪圖核心及其他IP方案的設計收斂。在PowerVR GE7800 GPU上,相較之前解決方案,Genus合成解決方案可改善週轉時間五倍,且不影響PPA。

於此同時,德州儀器(TI)也利用Genus合成解決方案來開發汽車與工業市場用處理器。該公司表示,Cadence高擴充性Genus合成解決方案可提升五倍以上的週轉時間,使我們能在8小時內完成高達3百萬instances的高生產品質timing-driven合成作業。

Cadence數位 Signoff與Signoff事業群資深副總裁暨總經理Anirudh Devgan博士指出:「透過Genus合成解決方案,我們見到了改善RTL設計生產力的絕佳契機,也能以大幅提升的架構層次最佳化作業有效改善PPA。先期客戶們已於其RTL設計流程中採用此解決方案,同時也證實此解決方案的週轉時間與產出量均大幅領先其他同級解決方案。」





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